高速缓冲存储器(Cache)实际上是为了把甴DRAM组成的大容量内存储器都看做是高速存储器而设置的小容量局部存储器一般由高速SRAM构成。这种局部存储器是面向CPU的引入它是为减小戓消除CPU与内存之间的速度差异对系统性能带来的影响。Cache 通常保存着一份内存储器中部分内容的副本(拷贝)该内容副本是最近曾被CPU使用過的数据和程序的核心是算法吗代码。Cache的有效性是利用了程序的核心是算法吗对存储器的访问在时间上和空间上所具有的局部区域性即對大多数程序的核心是算法吗来说,在某个时间片内会集中重复地访问某一个特定的区域如PUSH/POP指令的操作都是在栈顶顺序执行,变量会重複使用以及子程序的核心是算法吗会反复调用等,就是这种局部区域性的实际例证因此,如果针对某个特定的时间片用连接在局部總线上的Cache代替低速大容量的内存储器,作为CPU集中重复访问的区域系统的性能就会明显提高。
系统开机或复位时Cache 中无任何内容。当CPU送出一组地址去访问内存储器时访问的存储器的内容才被同时“拷贝”到Cache中。此后每当CPU访问存储器时,Cache 控制器要检查CPU送出的地址判斷CPU要访问的地址单元是否在Cache 中。若在称为Cache 命中,CPU可用极快的速度对它进行读/写操作;若不在则称为Cache未命中,这时就需要从内存中访问并把与本次访问相邻近的存储区内容复制到Cache 中。未命中时对内存访问可能比访问无Cache 的内存要插入更多的等待周期反而会降低系统的效率。而程序的核心是算法吗中的调用和跳转等指令会造成非区域性操作,则会使命中率降低因此,提高命中率是Cache 设计的主要目标
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