实验一半加器和全加器的设计
实驗三基本触发器的设计
实验四十进制加法计数器的设计
实验五八位七段数码管动态显示电路的设计
实验六基于VHDL的表决器的设计
EP2C35与开发平台硬件资源I/O接口对照表
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